Rev Age Author Path Log message Diff
1790 4891 d 5 h miho /Modules/ Přejmenování podstromu CPLD na CPLD_FPGA Diff
1789 4891 d 11 h miho / Vygenerované podklady pro amatérskou výrobu plošných spojů. Diff
1786 4897 d 23 h kaklik /Modules/Translators/TTLPECL01A/ vygenerovani technologickych vystupu Diff
1785 4897 d 23 h kaklik /Modules/Translators/TTLPECL01A/PCB/ Diff
1784 4898 d 0 h kaklik / zacatek navrhu spoje. Diff
1783 4898 d 4 h kaklik /Modules/Translators/TTLPECL01A/DOC/ Zalozena nоvá třída modulů pro převod signálových úrovní. Diff
1782 4898 d 4 h kaklik / presunuti mezi nove zavedeny typ modulu. Diff
1781 4898 d 6 h kaklik / Zalozena nоvá třída modulů pro převod signálových úrovní. Diff
1780 4899 d 1 h kaklik / vytvoren modul pro vlhkostni cidlo. Diff
1779 4899 d 1 h kaklik /Modules/Sensors/HUM01A/PCB/ zakladni verze PCB Diff
1778 4899 d 4 h kaklik /Modules/ zalozen novy modul - na mereni vlhkosti. Diff
1775 4902 d 4 h kaklik /Modules/TDC/GP201A/SW/PICinterface/ TDC nwmwri ani v modu 1 Diff
1774 4902 d 9 h kaklik /Modules/TDC/GP201A/SW/PICinterface/ pridani mereni teploty pomoci ccidla DS18B20 Diff
1767 4903 d 3 h kaklik /Modules/TDC/GP201A/SW/PICinterface/ pridani zdrojaku pro teplomer Diff
1766 4906 d 7 h kaklik /Modules/ARM/STM32F10xRxT/ dokonceni uprav PCB pro vyrobu. Diff
1765 4906 d 11 h kaklik /Modules/ARM/STM32F10xRxT/PCB/ pridani technologickych znacek. Diff
1764 4906 d 22 h kaklik /Modules/ARM/STM32F10xRxT/ aktualizace oprav chyb Diff
1763 4907 d 0 h kaklik /Modules/ARM/STM32F10xRxT/ přegenerování technologických výstupů Diff
1762 4907 d 0 h kaklik /Modules/ARM/STM32F10xRxT/ uklid ve slozkach modulu. Diff
1760 4907 d 0 h kaklik /Modules/TDC/GP201A/SW/PICinterface/ zmena absolutnich cest v projektu na relativni. Diff