Rev Age Author Path Log message Diff
1954 4820 d 13 h miho /Modules/CPLD_FPGA/S3AN01A/ Dokumentace pro S3AN01A (podomácku vyrobená verze) Diff
1953 4821 d 4 h kaklik /Modules/Clock/CLKGEN01B/DOC/SRC/ prejmenovani podle konvence Diff
1952 4821 d 4 h kaklik /Modules/Clock/CLKGEN01B/DOC/ oprava preklepu Diff
1950 4825 d 18 h miho /Modules/CPLD_FPGA/S3AN01B/ S3AN01B doplněny obrázky (pro dokumentaci) Diff
1947 4826 d 2 h kaklik / prejmenovani souboru podle konvence Diff
1946 4826 d 7 h kaklik /Modules/PIC/PIC18F8xTQ8001A/DOC/ aktualizace dokumentace Diff
1941 4828 d 15 h kaklik /Modules/H_Bridge/MPC17511HB01A/DOC/ oprava dokumentace Diff
1939 4830 d 13 h kaklik /Modules/Clock/CLKGEN01B/ preklad Diff
1937 4832 d 10 h miho /Modules/CPLD_FPGA/S3AN01B/PCB/ Aktualizovány hodnoty součástek (synchronizace se schématem). Diff
1936 4832 d 11 h miho /Modules/CPLD_FPGA/S3AN01B/SCH/ Aktualizovaný seznam součástek a cenový přehled (nutno doplnit reálnou cenu PCB z faktury). Diff
1935 4832 d 17 h miho /Modules/CPLD_FPGA/S3AN01B/SCH/ Aktualizace schématu (formální změny). Pracovní verze seznamu součástek. Diff
1934 4833 d 7 h kaklik /Modules/Clock/CLKGEN01B/DOC/ kus anglickeho prekladu Diff
1933 4833 d 7 h kaklik /Modules/Clock/CLKGEN01B/DOC/ kus anglickeho prekladu Diff
1932 4835 d 10 h kaklik /Modules/Clock/CLKGEN01B/DOC/ prejmenovani podle konvence Diff
1931 4838 d 2 h kaklik /Modules/TDC/GP201A/SW/PICinterface/ testovani TDC Diff
1930 4838 d 6 h kaklik / preklad kodu Diff
1914 4848 d 10 h kaklik /Modules/CommSerial/ETH02A/ Vygenerovani potisku Diff
1913 4848 d 10 h kaklik /Modules/CommSerial/ETH02A/ prace na modulu pro ethernet Diff
1912 4848 d 11 h kaklik /Modules/CommSerial/ETH02A/ prace na modulu pro ethernet Diff
1911 4849 d 4 h kaklik /Modules/ Vyvoj tistaku pro ETHERNET. Diff