←Prev12Next→ Show All
Rev Age Author Path Log message Diff
3592 3873 d 20 h kaklik /Modules/Clock/CLKDIV01A/ Opraveno oznaceni 1 u integrovaneh oobvodu. Diff
3590 3875 d 17 h kaklik /Modules/ zaznam nalezenych chyb. Diff
3509 3900 d 15 h kaklik /Modules/ pregenerovani dokumentace. Diff
3507 3901 d 9 h kaklik /Modules/ založen nový modul pro digitalizaci signálu z SDRX01B. Diff
3490 3914 d 15 h miho / Doplněna dokumentace firmwaru USBasp pro modul AVRUSB01, drobné opravy Diff
3475 3919 d 15 h kaklik / Pridani dalsi dokumentace. Diff
3459 3927 d 20 h kaklik / pridani obrazku nove vyvijenych konstrukci. Diff
3447 3946 d 18 h kaklik /Modules/Clock/CLKDIV01A/ pradani maleho obrazku modulu. Diff
3445 3946 d 18 h kaklik / zlepseni dokumentace modulu. Diff
3444 3946 d 19 h kaklik /Modules/Clock/CLKDIV01A/ zaznam chyb na modulu. Diff
3431 3951 d 16 h miho /Modules/Clock/CLK1PLL01A/SCH/ Diff
3430 3951 d 17 h miho /Modules/Clock/CLK1PLL01A/SCH/ Doplněn komentář. Diff
3429 3951 d 19 h miho /Modules/Clock/CLK1PLL01A/ Dogenerované PDF soubory Diff
3428 3952 d 0 h miho /Modules/Clock/CLK1PLL01A/ Opraven SCH a PCB CLK1PLL01A (oprava EN vývodů u stabilizátorů), nutno ještě přegenerovat PDF výstupy od plošného spoje (zde PDF995 generuje velmi nekvalitní výstupy, nutno použít něco funkčnějšího). Diff
3427 3953 d 20 h kaklik / vylepseni dokumentace studie prijimace Diff
3425 3955 d 11 h kaklik / pridani dalsi dokumentace. Diff
3424 3955 d 14 h miho /Modules/Clock/CLK1PLL01A/ Hodinový PLL generátor s obvodem TI CDCE913 (schema, PCB a technologické výstupy). Diff
3421 3957 d 16 h kaklik / vylepseni dokumentace. Diff
3404 3977 d 8 h kaklik /Modules/Clock/CLKDIV01A/ vygenerovani nahledu. Diff
3403 3977 d 8 h kaklik /Modules/Clock/CLKDIV01A/ oprava chyb z TODO. Diff